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| 工序 | 核心输送与保护功能 | 技术要点 | 良率影响 |
|---|---|---|---|
| 晶圆背磨 | 临时固定晶圆、吸收研磨冲击,薄化后洁净剥离 | 高粘附着 + 低剥离力,热收缩率 < 0.3%,防硅粉残留 | 剥离不良率从 2–3% 降至 0.1% 以下 |
| 晶粒切割 | 切割载带支撑,UV 曝光后离型力骤降,助力晶粒快速拾取 | UV 响应型离型层,尺寸稳定性 ±1μm,抗静电 < 10⁹Ω | 崩边率下降 50%,拾取效率提升 30% |
| 先进封装(Fan-out/WLP) | RDL 工序隔离保护、模封临时承载、芯片转移支撑 | 非硅离型层防硅污染,耐高温 150–200℃,低分子迁移 < 0.1μg/cm² | 封装良率至 99.7%,适配 Chiplet 高密度集成 |
| 光刻 / 薄膜转移 | 光刻胶涂布载带、敏感膜层转移载体 | 高透明度(雾度 < 1%),低硅油转移,耐化学腐蚀 | 光刻图案偏差 < 0.1μm,膜层转移无气泡 / 褶皱 |
| 测试 / 引线框架 | 保护镀层、防止测试过程划伤 / 氧化 | 离型力 10–15 g/25 mm,高温(125℃)下性能稳定 | 镀层损坏率从 3.2% 降至 0.7% |
洁净度与低迁移:Class 100 级洁净,低分子析出(硅油转移量 < 0.1μg/cm²),避免微颗粒污染与焊点不润湿。
热与尺寸稳定性:中温短时工况(≤150℃)下热收缩率 < 0.5%,适配模封 / 固化温度,防止翘曲与位移。
抗静电与兼容性:表面电阻 10⁸–10¹¹Ω 防 ESD 击穿,兼容光刻胶、模塑料等化学品,无界面反应。
精准离型控制:UV 响应型、热致型等定制化离型力,剥离时应力 < 5MPa,保护超薄芯片(≤50μm)不破损。
成本与效率平衡:PET 基材成本适中,适配中温短时工况,比 PI/PTFE 更具性价比,推动封装材料国产化替代。
良率与可靠性保障:作为制程 “防护盾”,减少返工与报废,单厂年节约成本可达数千万元。
技术升级方向:从硅系向非硅系离型层、复合基材(PET/PI)、高精度涂布(10 万级洁净)升级,适配 3D 封装、Chiplet 等先进制程。
国产化进展:国内企业在背磨、切割载带等领域已进入头部晶圆厂供应链,高端封装用非硅离型膜仍需突破。
来源:高工锂电 点击查阅详情
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